DS1232LP+ Componentes de circuito integrado do chip MicroMonitor de baixa potência

Chip micromonitor DS1232LP+ de baixa potência

CARACTERÍSTICAS

Versão de super baixo consumo de energia do DS1232

50 A corrente quiescente

Pára e reinicia um microprocessador fora de controle

Reinicia automaticamente o microprocessador após falha de energia

Monitora o botão para substituição externa

Monitoramento preciso da fonte de alimentação do microprocessador de 5% ou 10% DIP de 8 pinos, SOIC de 8 pinos ou pacote µ-SOP para economia de espaço disponível

Pacote SOIC opcional de 16 pinos disponível

Temperatura industrial –40°C a +85°C disponível, designado N

DESCRIÇÃO

O chip DS1232LP/LPS Low Power MicroMonitor monitora três condições vitais para um microprocessador: fonte de alimentação, execução de software e substituição externa.Primeiro, um circuito comparador e de referência com compensação de temperatura de precisão monitora o status do VCC.Quando ocorre uma condição fora da tolerância, um sinal interno de falha de energia é gerado, o que força a redefinição para o estado ativo.Quando o VCC retorna a uma condição de tolerância, os sinais de reinicialização são mantidos no estado ativo por no mínimo 250 ms para permitir que a fonte de alimentação e o processador se estabilizem.

A segunda função que o DS1232LP/LPS executa é o controle de reinicialização por botão.O DS1232LP/LPS debounce a entrada do botão e garante uma largura de pulso de reinicialização ativa de no mínimo 250 ms.A terceira função é um temporizador de vigilância.O DS1232LP/LPS tem um temporizador interno que força os sinais de reset para o estado ativo se a entrada do estroboscópio não for reduzida antes do tempo limite.A função do temporizador de vigilância pode ser configurada para operar em configurações de tempo limite de aproximadamente 150 ms, 600 ms e 1,2 segundos.

OPERAÇÃO - MONITOR DE ENERGIA

O DS1232LP/LPS detecta condições de fornecimento de energia fora da tolerância e avisa um sistema baseado em processador de falha de energia iminente.Quando VCC cai abaixo de um nível predefinido conforme definido por TOL, o comparador VCC emite os sinais RST e RST.Quando o TOL está conectado ao terra, os sinais RST e RST tornam-se ativos conforme o VCC cai abaixo de 4,75 volts.Quando o TOL está conectado ao VCC, os sinais RST e RST tornam-se ativos conforme o VCC cai abaixo de 4,5 volts.O RST e o RST são excelentes sinais de controle para um microprocessador, pois o processamento é interrompido nos últimos momentos possíveis de VCC válido.Ao ligar, RST e RST são mantidos ativos por no mínimo 250 ms para permitir que a fonte de alimentação e o processador se estabilizem.OPERAÇÃO – RESET DE BOTÃO O DS1232LP/LPS fornece um pino de entrada para conexão direta a um botão de pressão (Figura 1).A entrada de reset do botão requer um sinal baixo ativo.Internamente, esta entrada é debounced e cronometrada de forma que os sinais RST e RST de pelo menos 250 ms sejam gerados.O atraso de 250 ms começa quando a entrada de reset do botão é liberada do nível baixo.

OPERAÇÃO - TEMPORIZADOR DE GUARDA

A função do temporizador watchdog força os sinais RST e RST para o estado ativo quando a entrada ST não é estimulada por um período de tempo predeterminado.O período de tempo é definido pela entrada TD para ser tipicamente 150 ms com TD conectado ao terra, 600 ms com TD deixado desconectado e 1,2 segundos com TD conectado ao VCC.O cronômetro de vigilância começa a expirar a partir do período de tempo definido assim que RST e RST estiverem inativos.Se ocorrer uma transição de alto para baixo no pino de entrada ST antes do tempo limite, o temporizador watchdog é redefinido e começa a expirar novamente.Se o timer do watchdog tiver permissão para expirar, os sinais RST e RST serão direcionados para o estado ativo por no mínimo 250 ms.A entrada ST pode ser derivada de sinais de endereço do microprocessador, sinais de dados e/ou sinais de controle.Quando o microprocessador estiver funcionando normalmente, esses sinais, como uma questão de rotina, farão com que o watchdog seja reinicializado antes do tempo limite.Para garantir que o timer do watchdog não atinja o tempo limite, uma transição de alto para baixo deve ocorrer no mínimo ou abaixo do mínimo mostrado na Tabela 1. Um exemplo de circuito típico é mostrado na Figura 2.

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