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EPM3128ATC144-10 placa de circuito programável Chips IC programáveis ​​Família de dispositivos lógicos programáveis

fabricante:
Fabricante
Descrição:
IC CPLD 128MC 10NS 144TQFP
Categoria:
Motorista ICs da exposição
Preço:
Negotiate
Método do pagamento:
T/T, Western Union, Paypal
Especificações
Tensão de fonte:
– 0,5 a 4,6 V
A C.C. entrou a tensão:
– 2,0 a 5,75 V
Corrente de saída da C.C., pelo pino:
– 25 a 25 miliampères
Temperatura de armazenamento:
– 65 150 ao ° C
Temperatura ambiental:
– 65 135 ao ° C
TEMPERATURA DE JUNÇÃO:
135 ° C
Destaque:

programming ic chips

,

ic programmer circuit

Introdução

 
Família de dispositivos lógicos programáveis ​​MAX 3000A
Características
■ Dispositivos lógicos programáveis ​​(PLDs) baseados em CMOS EEPROM de alto desempenho e baixo custo construídos em uma arquitetura MAX®
■ Programação no sistema (ISP) de 3,3 V por meio do IEEE Std.1149.1 Interface Joint Test Action Group (JTAG) com capacidade avançada de bloqueio de pinos – circuito ISP compatível com IEEE Std.1532
■ Circuito integrado de teste de varredura de limite (BST) compatível com IEEE Std.1149.1-1990
■ Recursos ISP aprimorados: – Algoritmo ISP aprimorado para programação mais rápida – Bit ISP_Done para garantir programação completa – Resistor pull-up nos pinos de E/S durante a programação no sistema
■ PLDs de alta densidade variando de 600 a 10.000 portas utilizáveis
■ Atrasos lógicos pino a pino de 4,5 ns com frequências de contador de até 227,3 MHz
■ Interface de E/S MultiVoltTM permitindo que o núcleo do dispositivo funcione em 3,3 V, enquanto os pinos de E/S são compatíveis com níveis lógicos de 5,0–V, 3,3–V e 2,5–V
■ Contagens de pinos variando de 44 a 256 em uma variedade de pacote plano quádruplo fino (TQFP), pacote plano quádruplo de plástico (PQFP), porta-chips J-lead plástico (PLCC) e pacotes FineLine BGATM
■ Suporte de hot-socketing
■ Estrutura de roteamento contínuo de matriz de interconexão programável (PIA) para desempenho rápido e previsível
■ Faixa de temperatura industrial
■ Compatível com PCI
■ Arquitetura compatível com o barramento, incluindo controle de taxa de variação programável
■ Opção de saída de dreno aberto
■ Flip-flops de macrocélulas programáveis ​​com controles individuais de limpeza, predefinição, relógio e habilitação de relógio
■ Modo de economia de energia programável para uma redução de energia de mais de 50% em cada macrocélula
■ Distribuição configurável do termo do produto do expansor, permitindo até 32 termos do produto por macrocélula
■ Bit de segurança programável para proteção de projetos proprietários
■ Recursos arquitetônicos aprimorados, incluindo: – Sinais de habilitação de saída de 6 ou 10 pinos ou acionados por lógica – Dois sinais de relógio global com inversão opcional – Recursos de interconexão aprimorados para capacidade de roteamento aprimorada – Controle de taxa de variação de saída programável
■ Suporte de design de software e posicionamento e roteamento automáticos fornecidos pelos sistemas de desenvolvimento da Altera para PCs baseados em Windows e Sun SPARCstations e estações de trabalho HP 9000 Series 700/800
■ Entrada de design adicional e suporte de simulação fornecidos por arquivos netlist EDIF 2 0 0 e 3 0 0, biblioteca de módulos parametrizados (LPM), Verilog HDL, VHDL e outras interfaces para ferramentas EDA populares de fabricantes terceirizados, como Cadence, Exemplar Logic, Mentor Graphics, OrCAD, Synopsys, Synplicity e VeriBest
■ Suporte de programação com a unidade de programação mestre Altera (MPU), cabo de comunicação MasterBlasterTM, cabo de download de porta paralela ByteBlasterMVTM, cabo de download serial BitBlasterTM, bem como hardware de programação de fabricantes terceirizados e qualquer testador de circuito compatível com teste e programação padrão JamTM Arquivos de idioma (STAPL) (.jam), arquivos Jam STAPL Byte-Code (.jbc) ou arquivos de formato de vetor serial (.svf)
Descrição Funcional
A arquitetura do MAX 3000A inclui os seguintes elementos:
■ Blocos de matriz lógica (LABs)
■ Macrocélulas
■ Termos do produto expansor (compartilhável e paralelo)
■ Matriz de interconexão programável (PIA)
■ Blocos de controle de E/S
A arquitetura do MAX 3000A inclui quatro entradas dedicadas que podem ser usadas como entradas de uso geral ou como sinais de controle global de alta velocidade (clock, clear e dois sinais de habilitação de saída) para cada macrocélula e pino de E/S.A Figura 1 mostra a arquitetura dos dispositivos MAX 3000A.
Figura 1. Diagrama de blocos do dispositivo MAX 3000A
Nota: (1) Os dispositivos EPM3032A, EPM3064A, EPM3128A e EPM3256A possuem seis habilitações de saída.Os dispositivos EPM3512A têm 10 habilitações de saída.
Classificações máximas absolutas do dispositivo MAX 3000A

SímboloParâmetroCondiçõesmín.máx.Unidade
VCCTensão de alimentaçãoCom relação ao solo(1)–0,54.6V
VEUTensão de entrada CC-2,05,75V
EUFORACorrente de saída DC, por pino –2525mA
TSTGTemperatura de armazenamentoSem viés–65150°C
TATemperatura ambientesob preconceito–65135°C
TJTemperatura de junçãoPacotes PQFP e TQFP, sob viés 135°C

Observação:
(1) A tensão mínima de entrada CC é –0,5 V. Durante as transições, as entradas podem atingir –2,0 V ou ultrapassar para 5,75 V para correntes de entrada menores que 100 mA e períodos menores que 20 ns.
 
 
 
Oferta de Ações (Venda a Quente)

Nº da peçaQ'tyMFGD/CPacote
MBC13900NT113775FREESCAL16+SOT
ATTINY13A-PU3300ATMEL14+DIP-8
LM317AEMP10000NSC14+SOT-223
MC9S08SH4CTG4690ESCALA LIVRE10+TSSOP
MC9S08GT8AMFBE4588ESCALA LIVRE15+QFP
LM2595S-3.36580NSC14+TO-263
MMBTA06LT1G20000SOBRE16+SOT-23
PALCE16V8H-15JC/410740AMD14+PLCC
LP621024DM-70LLF1362AMIC15+SOP-32
MAX1232CSA10000MÁXIMA16+POP
CY62148ELL-45ZSXI2212CIPRESTE11+TSOP32
PL2303RA1000PROLÍFICO15+SSOP-28
PXAG49KBBD2000PHI04+QFP-44
MC9S08QD2CSC4636ESCALA LIVRE13+SOIC
XC95144XL-10TQG100C119XILINX15+TQFP100
PIC18F1220-I/SO4688MICROCHIP10+POP
NZL6V8AXV3T1G40000SOBRE16+SOT-523
NC7SZ38P5X40000FAIRCHILD16+SOT-353
MMBT6427LT1G20000SOBRE16+SOT-23
LNK626DG4878PODER13+SOP-7
NCP1402SN50T1G11200SOBRE11+SOT23-5

 
 
 
 

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