A microplaqueta 256K do circuito integrado paginou EEPROM paralelo AT28C256-15PU
chip in electronics
,integrated components
Características
• Tempo de acesso lido rápido
– 150 ns
• A página automática escreve a operação
– Travas de endereço interno e de dados para 64 bytes
– Temporizador do controle interno
• Escreva rapidamente tempos de ciclo
– A página escreve o tempo de ciclo: 3 Senhora ou 10 Senhora máximo
– a página de 1 a 64 bytes escreve a operação
• Dissipação de baixa potência
– corrente ativa de 50 miliampère
– corrente à espera do CMOS de 200 µA
• Proteção de dados do hardware e do software
• A votação dos DADOS para o fim de escreve a detecção
• Tecnologia alta do CMOS da confiança
– Resistência: 104 ou 105 ciclos
– Retenção dos dados: 10 anos
• Única 5V fonte do ± 10%
• CMOS e entradas e saídas compatíveis de TTL
• JEDEC aprovou Pinout Byte-largo
• Variações da temperatura militares e industriais completas
• Opção de empacotamento do verde (Pb/Halide-free)
Pin Configurations
| Pin Name | Função |
| A0 - A14 | Endereços |
| CE | Chip Enable |
| OE | A saída permite |
| NÓS | Escreva permitem |
| I/O0 - I/O7 | Entradas de dados/saídas |
| NC | Nenhum conecte |
| C.C. | Não conecte |
Descrição
O AT28C256 é eletricamente uma memória de leitura apenas apagável e programável de capacidade elevada. Seu 256K da memória é organizado como 32.768 palavras por 8 bocados. Fabricado com tecnologia permanente avançada do CMOS de Atmel, o dispositivo oferece tempos de acesso a 150 ns com dissipação de poder de apenas 440 mW. Quando o dispositivo deselected, a corrente à espera do CMOS é menos do µA 200.
O AT28C256 é alcançado como RAM estático para lida ou escreve o ciclo sem a necessidade para componentes externos. O dispositivo contém um registro da página de 64 bytes para permitir simultaneamente a escrita de até 64 bytes. Durante para escrever o ciclo, os endereços e 1 a 64 bytes dos dados são travados internamente, livrando o ônibus do endereço e de dados para outras operações. Depois da iniciação do para escrever o ciclo, o dispositivo redigirá automaticamente os dados travados usando um temporizador do controle interno. O fim do para escrever o ciclo pode ser detectado pela votação dos DADOS de I/O7. Uma vez que o fim do escreve o ciclo foi detectado um acesso novo para lida ou escreva pode começar.
O AT28C256 de Atmel tem as características adicionais para assegurar de alta qualidade e o manufacturability. O dispositivo utiliza de correção de erros interno para resistência prolongada e características melhoradas da retenção dos dados. Um mecanismo opcional da proteção de dados do software está disponível para guardar contra inadvertido escreve. O dispositivo igualmente inclui 64 bytes extra de EEPROM para a identificação ou o seguimento de dispositivo
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